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  Quartus II 5.0 Design Flow           ★★★ 【字体:
Quartus II 5.0 Design Flow
作者:Free    文章来源:本站原创    点击数:    更新时间:2008-2-15    
鉴于目前对Synplify Pro和ModelSim了解很少,而且不怎么会用,用的时候三个工程的文件放在一起,乱糟糟的。
现在先只用Quartus自带的综合和仿真工具吧,没看出有什么不好的。

1. 建立目录。格式推荐如下:
    + project_name
    |-dev  把工程目录定在这儿
    |-src  把源代码放这
    |-core  IP core dec
    |-sim   simulate
    |-doc   documents
2. 新建工程。工程名任意。顶层模块名必须与顶层模块文件名相同。
3. 使用Assignment Editor设计约束
   <1> 选择Processing/Start/Start Analysis & Elaboration,检查语法和语义错误。
   <2> Assignment/Assignment Editor,
       Pin  选择分配信号、器件管脚、I/O电压标准
       Timing 时序约束
4. 综合
   <1> 使用自带综合工具
   <2> 使用第三方综合工具(Synplify Pro)
     注意:虽然第三方综合工具功能强大,优化效果好,但是Quartus自带的工具有自身的优点。
     总结用法:
     用Synplify Pro建立工程和VHDL文件->编译->约束->Launch Quartus II
5. 布局布线

6. 仿真(功能仿真、综合后仿真、布线后仿真)
   首先需要建立矢量源文件,即激励文件。较常用的是波形文件(.vwf)。
   建立仿真之前设定好settings/simulator,如果是Functional仿真,需要Processing/Generate Functional Simulation Netlist。
   Modelsim总结用法:
   先用QuartusII建立波形文件,然后Export成Testbench。
   在EDA Tools 中设定Modelsim仿真工具,然后选中编译时自动调用。在More Settings中设定testbench输入文件。

文章录入:admin    责任编辑:admin 
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